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第1篇 高級asic設計工程師/senior asic design engineer職位描述與崗位職責任職要求
職位描述：
崗位職責：
制定圖像處理，視頻編解碼和其它算法硬件實現的微架構
rtl級asic設計，驗證和集成
電路綜合，以及基于時序，面積和功耗的設計優(yōu)化
撰寫asic設計的相關文檔
協同架構組、軟件組一起開發(fā)調試fpga或者芯片
崗位要求：
碩士及以上學歷，三年以上相關工作經驗
精通硬件描述語言(verilog， systemverilog)及腳本語言(perl，shell)
有圖像視頻處理領域相關經驗
熟悉各種amba總線協議
熟練使用asic設計工具，熟悉asic設計流程
具有較強的溝通、學習和撰寫英文文檔的能力
responsibilities:
develope micro-architecture for isp， video codec and other algorithms
rtl design， verification and integration
synthesis and optimize for timing， area and power
module and top-level documentation
work with architecture and software teams to develop ne_t-generation silicon.
qualifications:
ms with at least 3 year's equivalent e_perience
fluent with hdl languages(verilog， systemverilog)
e_perience in video codec， isp and so on
familiar with software languages c/c++
familiar with eda tools and cad flow
good documentation and communication skills
第2篇 asic項目經理職位描述與崗位職責任職要求
職位描述：
asic項目經理
崗位描述：
1. 收集和分析需求，制定項目計劃，定義項目范圍和可交付成果，并確定資源需求
2. 組建，協調和管理項目資源，負責項目風險和質量管理，確保項目保質保量如期完成
3. 定期召開項目會議，負責項目的進度跟蹤，對項目中各種問題進行記錄及溝通解決，確保項目的進展及相關問題及時地反映給管理層
4. 負責和組織編寫相關項目實施文檔
任職要求：
1. 電子、電氣、自動化等相關專業(yè)本科以上學歷
2. 具有 5 年以上項目管理的相關工作經驗
2. 熟悉 asic項目 或者板級系統項目開發(fā)流程
3. 掌握系統的項目管理方法，具備良好的綜合協調能力和項目推進能力
4. 具備責任心及團隊協作精神，良好的溝通與交流能力，善于處理各種人際關系
優(yōu)先錄用：
有相關和foundry，ip vender之類溝通的經驗和資源
第3篇 asic設計工程師崗位職責
asic設計工程師 職位描述:
1. 理解mac層調度方法;
2. 負責mac層架構設計和rtl實現;
3. 負責mac和soc以及物理層接口設計;
4. 負責mac 層fpga驗證;
5. 配合mac層整體的前端綜合和后端timing signoff;
6. 配合提供mac驅動程序;
7. mac層相關模塊的優(yōu)化和維護;
任職要求:
1. 計算機或電子類專業(yè)本科及以上學歷,1年以上工作經驗;
1. 熟悉arm總線協議;
2. 熟悉wifi/bluetooth/nbiot/ ethernet 至少一種mac層協議;
3. 良好的算法理解能力;
4. 熟悉芯片asic前端設計流程;
5. 熟練的verilog/c/c++/matlab/perl 等編程能力;
6. 有成功流片項目經驗者優(yōu)先; 1. 理解物理層算法以及配合物理層算法研發(fā);
2. 負責物理層算法的rtl 實現;
3. 設計物理層微架構;
4. 評估物理層算法實現后的的性能;
5. 負責相關模塊的模塊級別驗證工作;
6. 負責相關模塊的fpga原型驗證工作;
7. 配合相關模塊的前端綜合和后端timing signoff;
8. 配合底層驅動工程師完善相關模塊的驅動;
9. 物理層相關模塊的優(yōu)化和維護;
任職要求:
1. 計算機或通信類專業(yè)本科及以上學歷,1年以上工作經驗;
2. 掌握信號處理算法;
3. 熟悉wifi/bluetooth/nbiot/ethernet/3g/4g/5g 至少一種物理層算法優(yōu)先;
4. 良好的算法理解能力;
5. 熟悉芯片asic前端設計流程;
6. 熟練的verilog/c/c++/matlab/perl 等編程能力;
7.有成功流片項目經驗者優(yōu)先; 職位描述:
1. 理解mac層調度方法;
2. 負責mac層架構設計和rtl實現;
3. 負責mac和soc以及物理層接口設計;
4. 負責mac 層fpga驗證;
5. 配合mac層整體的前端綜合和后端timing signoff;
6. 配合提供mac驅動程序;
7. mac層相關模塊的優(yōu)化和維護;
任職要求:
1. 計算機或電子類專業(yè)本科及以上學歷,1年以上工作經驗;
1. 熟悉arm總線協議;
2. 熟悉wifi/bluetooth/nbiot/ ethernet 至少一種mac層協議;
3. 良好的算法理解能力;
4. 熟悉芯片asic前端設計流程;
5. 熟練的verilog/c/c++/matlab/perl 等編程能力;
6. 有成功流片項目經驗者優(yōu)先;
第4篇 高級asic驗證工程師職位描述與崗位職責任職要求
職位描述：
崗位職責：
搭建模塊級和系統級uvm驗證環(huán)境
根據設計需求文檔制定模塊級和系統級驗證方案，跟設計工程師一起審查設計和驗證
驗證整個設計，調試各種錯誤與設計中的bug
管理驗證的審查，建立代碼質量的標準
崗位要求：
碩士及以上學歷，三年以上相關工作經驗
精通verilog，systemverilog，sva及腳本語言(perl， shell等)
精通uvm驗證的工具和環(huán)境
有視頻編解碼，圖像處理和外設(mipi、usb，存儲控制器等)調試經驗者優(yōu)先
具有較強的溝通、學習和撰寫英文文檔的能力
responsibilities：
build system and unit-level uvm verification environment
create system and unit-level verification plans from specification and review with design engineers
debug failures and manage bug tracking
conduct verification reviews and set standard for coding quality
qualifications：
master degree or above， with 3+ years working e_perience
proficiency in system verilog， object oriented programming， scripting languages
e_perience in uvm development a plus
e_perience in debugging designs of video codec， isp and peripherals (mipi， usb， memory controller， etc.) is a plus
e_cellent written， verbal and presentation skills
第5篇 高級asic設計工程師崗位職責任職要求
高級asic設計工程師崗位職責
職責描述:
1. 與架構師合作，編寫設計文檔。
2. 完成rtl編碼、ut。
3. 協助驗證工作，提升驗證覆蓋率，支持fpga測試。
4. 協助后端工作，支持sta、formality、dft、ate等各項流程。
任職要求:
1. 5年以上verilog /asic設計經驗。
2. 精通綜合工具和靜態(tài)時序分析方法。
3. 具有數據網絡二層/三層交換芯片的的經驗，熟悉網絡測試工具和測試方法。
4. 熟悉tcl或者perl腳本語言。
5. 團隊合作精神。
6. 熟悉dft、scan insertion、ate等。
高級asic設計工程師崗位
第6篇 senior asic設計工程師職位描述與崗位職責任職要求
職位描述：
主要職責：
1. 定義相關ip的微結構
2. 帶領整個團隊進行ip的開發(fā)
崗位要求：
1. 碩士學位及5年以上相關工作經驗
2. 熟悉asic芯片前端設計的各個方面，包括但不限于: rtl代碼編寫，綜合，時許分析，功耗分析和dft等
3. 擁有完整的全流程ip設計的經驗，從初始需求到最終gds
4. 擁有帶領5人以上團隊開發(fā)的經驗
擁有以下經驗優(yōu)先：
1. 相關ai芯片設計經驗
2. usb/ddr phy等ip使用經驗
3. uvm等相關使用經驗。
第7篇 高級asic設計工程師崗位職責
高級asic設計工程師 上海登臨科技有限公司 上海登臨科技有限公司,登臨 職位信息:
根據特定算法或者架構需求定義模塊的微架構;
運用verilog完成模塊的rtl實現;
對設計進行power/timing/area分析和優(yōu)化;
fpga/silicon debug;
完成相關設計文檔的編寫和整理;
任職要求:
電子及相關本科以上專業(yè);
3年及以上相關經驗;
有asic設計經驗,有很強的verilog 設計/實現技能,對數字設計的ppa有充分的理解;
具有獨立解決問題的能力,良好的團隊合作意識和溝通能力;
第8篇 芯片asic設計工程師職位描述與崗位職責任職要求
職位描述：
工作職責：
1、為公司芯片提供asic設計（pd/dft/dfr/dfm）和工藝開發(fā)
2、負責芯片asic設計平臺建設，提高效率；
3、負責芯片floorplan規(guī)劃，物理可實現分析、dft/dfd等可測性設計方案制定、設計實現，仿真驗證，sta時序分析，ate測試向量交付等。負責實施從netlist到gds2的所有物理設計。
4、設計過程數據分析、測試大數據分析、良率提升等
任職要求：
業(yè)務技能要求：
1、熟練掌握深亞微米后端物理設計流程，熟練使用數字芯片物理設計/驗證工具；
2、熟悉ic dft或ic邏輯設計流程，熟練使用 synopsys 或 mentor 的相關工具。
專業(yè)知識要求：
1、具備asic設計相關的知識和能力，對新工藝有一定了解；
2、或了解后端物理設計流程，有數字芯片物理設計/驗證工具相關經驗；
3、或了解dft或ic邏輯設計流程，有eda（synopsys/cadence/ansys/mentor/華大等）工具相關經驗
4、或了解python/數據庫/web/tensorflow/ml，具有一定大數據分析能力
第9篇 高級asic設計經理/sr. asic design manager職位描述與崗位職責任職要求
職位描述：
崗位職責：
制定isp，視頻編解碼和其它算法硬件實現的微架構
rtl級asic設計，驗證和集成
電路綜合，以及基于時序，面積和功耗的設計優(yōu)化
撰寫asic設計的相關文檔
協同架構組、軟件組一起開發(fā)調試fpga或者芯片
管理設計團隊，使整個團隊緊密合作、高效工作
崗位要求：
碩士及以上學歷，六年以上相關工作經驗
精通硬件描述語言(verilog， systemverilog)及腳本語言(perl，shell)
有圖像視頻處理領域相關經驗
熟練使用asic設計工具，熟悉asic設計流程
具有較強的溝通、學習和撰寫英文文檔的能力
responsibilities:
develope micro-architecture for isp， video codec and other algorithms
rtl design， verification and integration
synthesis and optimize for timing， area and power
module and top-level documentation
work with architecture and software teams to develop ne_t-generation silicon.
manage the team to let members work closely and efficiently
qualifications:
ms with at least 6 year's equivalent e_perience
fluent with hdl languages(verilog， systemverilog)
e_perience in video codec， isp and so on
familiar with software languages c/c++
familiar with eda tools and cad flow
good documentation and communication skills
